SRS/DG645/回收|SRS DG645 数字延迟发生器

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详细资料：

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DG645 数字延迟发生器

DG645 是一款多功能数字延迟/脉冲发生器，可在高达 10 MHz 的重复频率下提供精确定义的脉冲。与旧设计相比，该仪器提供了多项改进 — 更低的抖动、更高的精度、更快的触发速率和更多的输出。DG645 还具有以太网、GPIB 和 RS-232 接口，用于仪器的计算机或网络控制。

Delay Generator Timing（延迟发生器时序）

时序图

所有数字延迟发生器都通过计算快速时钟（通常为 100 MHz）的周期来测量时间间隔。大多数数字 delay 发生器还具有较短的可编程模拟 delay，以实现比 clock period 更精细的时间间隔。不幸的是，如果 trigger 与 clock同相，则可能会出现一个 timing indeterminancy 的 clock cycle （通常为 10 ns）。

DG645 通过测量触发器相对于内部时钟的时序并补偿模拟延迟来消除时序不确定性。这种方法将抖动降低了约 100×并允许内部速率发生器以任何速率运行，而不仅仅是时钟频率的子倍数。

触发

DG645 具有多种触发模式。内部速率发生器的周期抖动小于 100 ps，可设置为 100 μHz 至 10 MHz，分辨率为 1 μHz。具有可调阈值和斜率的外部触发输入可以触发一个定时周期、一个周期的突发或单次触发。可以通过按键触发单发。线路触发器与交流电源同步运行。后面板 trigger inhibit input 可以在定时周期内禁用 trigger 或任何脉冲输出。

DG645 通过触发释抑和预分频功能支持许多复杂的触发要求。

Trigger holdoff （触发器抑制） 设置连续触发器之间的最短时间。如果应用程序中的 trigger 事件生成了显著的噪声瞬变，并且在生成下一个触发器之前需要时间衰减，则此功能非常有用。触发释抑也可用于以输入触发速率的子倍数触发 DG645。

前面板输出

触发预分频使 DG645 能够与更快的信号源同步触发，但触发频率是原始触发频率的子倍数。例如，DG645 可以在 1 kHz 时触发，但通过将触发输入预分频 80,000 来与以 80 MHz 运行的锁模激光器同步触发。此外，DG645 还为每个前面板输出包含一个单独的预分频器，使每个输出能够以触发速率的子倍数运行。

前面板输出

前面板有五个输出：T0、AB、CD、EF 和 GH。The T0output 在 timing cycle的持续时间内被置位。T 的前沿0是零时间参考。编程延迟（A、B、C、D、E、F、G 和 H）设置为 0 s 至 2000 s，分辨率为 5 ps，以控制四个脉冲输出的前沿和后沿的时序。

每个前面板输出可以驱动 50 Ω 负载，并具有 50 Ω 源阻抗。输出幅度可设置为 0.5 至 5.0 V，输出偏移范围可达 ±2 VDC，几乎可以提供任何逻辑电平（NIM、ECL、PECL、CMOS 等）。在任何输出幅度下，输出转换时间均小于 2 ns。

组合输出

后面板输出

可选的后面板输出可用于支持各种应用。选项 1 提供 T0输出和 8 个编程延迟（A、B、C、D、E、F、G 和 H），5 V 逻辑电平，转换时间小于 1 ns。选项 2 提供相同的输出，但为 30 V、100 ns 脉冲，在高噪声环境中进行时序分配时转换时间小于 5 ns。选项 3 提供 8 个组合输出，可在 5 V 逻辑电平下提供 1 至 4 个脉冲，转换时间小于 1 ns。每个输出都有一个 50 Ω 的源阻抗。

时基

标准时基的精度为 5 ppm，抖动为10-8，适用于许多应用程序。对于需要更好的速率和延迟精度或降低速率和延迟抖动的用户，可以使用可选的时基。

对于标准时基，1 s 延迟的定时误差可能高达 5 μs，对于 OCXO 时基，则为 200 ns，但对于铷时基，则仅为 500 ps（校准后均已一年）。

Timing Error vs. Delay

对于短延迟，抖动通常为 20 ps。但是，对于 1 s 的延迟，标准时基可以产生高达 10 ns 的抖动，而可选时基产生的额外抖动不到 10 ps。

快速上升时间模块

DG645 前面板输出的转换时间小于 2 ns。SRD1 是一个附件，内置于直插式 BNC 连接器中，可将前面板输出的上升时间缩短到 100 ps 以下。最多可将 5 个 SRD1 连接到前面板，以缩短所有输出的上升时间。

仪器保证：

我们的大多数设备在装运之前均经过严格的质量检测与校验。也可申请国家计量证书。